FPGA Intel® IP Ethernet 25G
Ce cœur IP met en œuvre la spécification Ethernet 25G et 50G, version préliminaire 1.4 issue du Consortium 25 Gigabit Ethernet. Le cœur IP comprend une option permettant de prendre en charge le transport unidirectionnel, tel que défini dans la Clause 66 de la norme Ethernet IEEE 802.3-2012. L'interface côté client de la sous-couche MAC pour le cœur IP 25GbE est une interface Avalon® partage (Avalon-ST) 64 bits. Elle correspond à un émetteur-récepteur de 25,78125 Gbit/s. Le cœur IP comprend en option la correction d'erreurs de transfert (FEC) de Reed-Solomon pour la prise en charge du câble DAC (direct attach copper).
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Lire le manuel d'utilisation du FPGA Intel® Stratix® 10 IP Ethernet 25G ›
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Lire le manuel d'utilisation de l'exemple de conception du FPGA Intel® Stratix® 10 IP Ethernet 25G ›
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