Opérateur de mappage de tonalité (TMO) Intel® FPGA IP
L'opérateur de cartographie des tonalités (TMO) Intel® FPGA IP corrige les images et les vidéos mal exposées pour révéler des détails invisibles.
Fiche de produit TMO Intel® FPGA
Guide de l'utilisateur de la suite de traitement vidéo et vision Intel® FPGA IP ›
Opérateur de mappage de tonalité (TMO) Intel® FPGA IP
Présentation
La TMO Intel FPGA IP modifie le contraste d'un flux vidéo pour améliorer la visibilité dans une grande variété d'applications, telles que l'imagerie médicale, la vidéoconférence, la projection de la lumière du jour, les caméras de sécurité et la vision industrielle. L'IP est basée sur la tuile pour prendre en charge les variations d'exposition locales, améliorant la visibilité des détails d'images latentes afin d'améliorer et de faciliter l'expérience d'affichage globale. Le noyau IP TMO accepte l'entrée vidéo RGB comme AXI4-Stream, analyse statistiquement la luminance de l'image (localement et mondiale) et ajuste dynamiquement les composants d'images pour améliorer le contraste global de l'image. Ces opérations améliorent les images sous-exposées et underexposed pour utiliser pleinement la plage dynamique disponible. La IP TMO nécessite un processeur externe, comme processeur Nios® II FPGA softcore, pour permettre la configuration des blocs IP TMO et prendre des mesures via le bus de registre.
Caractéristiques
- Analyse des statistiques d'images locales multi-tuiles
- Prise en charge des 8, 10 et 12 bits par composants de couleur
- Supporte jusqu'à 4 pixels en parallèle par traitement d'horloge
- Faible latence des sous-trames (~ 100 cycles d'horloge)
- Prise en charge de résolutions jusqu'à 4K à 60 fps sur les FPGA Intel® C10/A10/S10 et jusqu'à 8K à 60 fps sur les FPGA Intel® Agilex™.
- FPGA faible utilisation des ressources
- Interface d'E/S vidéo AXI4-Stream
- Convertisseurs de protocole d'interface de diffusion Avalon® ↔AXI4-Stream
- Interfaces de commande et de mémoire de l'unité centrale Avalon® mappées en mémoire
Mesures de qualité IP
Basique |
|
|---|---|
L'année IP a été publiée |
2021 |
Dernière version du logiciel Intel® Quartus® prise en charge |
21,3 |
Statut |
Production |
Livrables |
|
Les livrables des clients comprennent les éléments suivants :
|
Oui |
Tout livrable de clients supplémentaire fourni avec l'IP |
Banc d'essai et exemple de conception |
GUI de paramétrage permettant à l'utilisateur final de configurer l'IP |
Oui |
Le noyau IP est activé pour le support du mode d'évaluation de l'Intel FPGA IP. |
Oui |
Langage source |
Verilog |
Langage Testbench |
Verilog |
Pilotes logiciels fournis |
Oui |
Prise en charge OS du pilote |
Métal nu |
Mise en œuvre |
|
Interface utilisateur |
Protocole de vidéo en continu Intel® FPGA, Intel® Avalon® Memory-Mapped |
Métadonnées IP-XACT |
Non |
Vérification |
|
Simulateurs pris en charge |
VCS, VCS MX, Active-HDL, Riviera-PRO, Xcelium, Questa-Intel® FPGA Edition, Questa |
Matériel validé |
Intel® Arria® 10 GX |
Réalisation de tests de conformité aux normes de l'industrie |
Non |
Si oui, quel(s) test(s) ? |
— |
Si oui, sur quel(s) dispositif(s), FPGA Intel ? |
— |
Si oui, date exécutée |
— |
Si non, est-il planifié ? |
— |
Interopérabilité |
|
L'IP a passé des tests d'interopérabilité |
Oui |
Si oui, sur quel(s) dispositif(s), FPGA Intel ? |
Intel® Cyclone® 10, Intel Arria® 10, Intel Straitix® 10, Intel Agilex™ |
Rapports d'interopérabilité disponibles |
Non |
Exemple de conception
Basé sur la conception de la conversion de format vidéo Intel® Arria® 10 UHD HDMI 2.0 avec un pipeline vidéo simplifié et des commandes supplémentaires pour faire fonctionner et programmer l'IP.
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