Opérateur de mappage de tonalité (TMO) Intel® FPGA IP
L'opérateur de cartographie des tonalités (TMO) Intel® FPGA IP corrige les images et les vidéos mal exposées pour révéler des détails invisibles.
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Opérateur de mappage de tonalité (TMO) Intel® FPGA IP
La TMO Intel FPGA IP modifie le contraste d'un flux vidéo pour améliorer la visibilité dans une grande variété d'applications, telles que l'imagerie médicale, la vidéoconférence, la projection de la lumière du jour, les caméras de sécurité et la vision industrielle. L'IP est basée sur la tuile pour prendre en charge les variations d'exposition locales, améliorant la visibilité des détails d'images latentes afin d'améliorer et de faciliter l'expérience d'affichage globale. Le noyau IP TMO accepte l'entrée vidéo RGB comme AXI4-Stream, analyse statistiquement la luminance de l'image (localement et mondiale) et ajuste dynamiquement les composants d'images pour améliorer le contraste global de l'image. Ces opérations améliorent les images sous-exposées et underexposed pour utiliser pleinement la plage dynamique disponible. La IP TMO nécessite un processeur externe, comme processeur Nios® II FPGA softcore, pour permettre la configuration des blocs IP TMO et prendre des mesures via le bus de registre.
Démo du TMO sur le FPGA SX Intel® Arria® 10 SX
Regardez la vidéo pour voir un expert technique interne démontrer les capacités du TMO Intel® FPGA IP.
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Exemple de conception UDX Warp TMO 3D LUT (WT3) du FPGA Intel® Arria® 10 IP SoC
L'exemple de conception utilisé dans la vidéo est basé sur le design de conversion vidéo au format UHD HDMI 2.0 du FPGA Intel® Arria® 10 SX avec un pipeline vidéo simplifié et des contrôles GUI basées sur le Web pour faire utiliser et programmer les IP présentées. Il démontre le fonctionnement des IP Warp, TMO et 3DLUT Intel FPGA. Pour télécharger cet exemple de conception, connectez-vous à votre compte intel.com.
Caractéristiques
- Analyse des statistiques d'images locales multi-tuiles
- Prise en charge des 8, 10 et 12 bits par composants de couleur
- Supporte jusqu'à 4 pixels en parallèle par traitement d'horloge
- Faible latence des sous-trames (~ 100 cycles d'horloge)
- Prise en charge des résolutions jusqu'à 4K à 60 ips sur les FPGA Intel® C10/A10/S10 et jusqu'à 8K à 60 ips sur les FPGA Intel® Agilex™ 7
- FPGA faible utilisation des ressources
- Interface d'E/S vidéo AXI4-Stream
- Convertisseurs de protocole d'interface de diffusion Avalon® ↔AXI4-Stream
- Interfaces de commande et de mémoire de l'unité centrale Avalon® mappées en mémoire
Mesures de qualité IP
Basique |
|
|---|---|
L'année IP a été publiée |
2021 |
Dernière version du logiciel Intel® Quartus® prise en charge |
Oui |
Statut |
Production |
Livrables |
|
Les livrables des clients comprennent les éléments suivants :
|
Oui |
Tout livrable de clients supplémentaire fourni avec l'IP |
Banc d'essai et exemple de conception |
GUI de paramétrage permettant à l'utilisateur final de configurer l'IP |
Oui |
Le noyau IP est activé pour le support d'Intel FPGA IP Evaluation Mode. |
Oui |
Langage source |
Verilog |
Langage Testbench |
Verilog |
Pilotes logiciels fournis |
Oui |
Prise en charge OS du pilote |
Métal nu |
Mise en œuvre |
|
Interface utilisateur |
Protocole de vidéo en continu Intel® FPGA, Intel® Avalon® Memory-Mapped |
Métadonnées IP-XACT |
Non |
Vérification |
|
Simulateurs pris en charge |
VCS, VCS MX, Active-HDL, Riviera-PRO, Xcelium, Questa-Intel® FPGA Edition, Questa |
Matériel validé |
Intel® Arria® 10 GX |
Réalisation de tests de conformité aux normes de l'industrie |
Non |
Si oui, quel(s) test(s) ? |
— |
Si oui, sur quel(s) dispositif(s), FPGA Intel ? |
— |
Si oui, date exécutée |
— |
Si non, est-il planifié ? |
— |
Interopérabilité |
|
L'IP a passé des tests d'interopérabilité |
Oui |
Si oui, sur quel(s) dispositif(s), FPGA Intel ? |
Intel® Cyclone® 10, Intel Arria® 10, Intel Straitix® 10, Intel Agilex™ |
Rapports d'interopérabilité disponibles |
Non |
Exemple de conception du TMO UDX Intel FPGA IP sur le FPGA Intel® Arria® 10 GX
Cet exemple de conception présente le TMO Intel FPGA IP comme un moteur d'amélioration du contraste. Il est basé sur le modèle de conversion du format vidéo HDMI 2.0 du FPGA Intel® Arria® 10 GX avec un pipeline vidéo simplifié et des commandes supplémentaires pour faire fonctionner et programmer le TMO.
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L'équipe des services de conception des FPGA Intel® a développé un ensemble d'expertises et une multitude de propriétés intellectuelles (PI) pour résoudre les problèmes de conception des clients dans les domaines de la vidéo intelligente et du traitement de la vision. Nos concepteurs chevronnés et doués n'attendent que de répondre aux besoins de vos conceptions avec leurs solutions les plus efficaces et les plus innovantes, se servant de notre bibliothèque de propriété intellectuelle hautement optimisée et éprouvée. Nous couvrons une grande variété d'applications allant de l'électronique grand public à la conception spécialisée de volume moyen sur des marchés tels que, mais sans s'y limiter, l'imagerie médicale, ProAV, l'industrie, le militaire et la diffusion.
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