FPGA Cyclone® V et FPGA SoC
Cyclone® V FPGA a une consommation totale inférieure à celle de la génération précédente, des capacités d’intégration logique efficaces, des variantes d’émetteur-récepteur intégrées et des variantes de SoC FPGA avec un système de processeur dur (HPS) basé sur ARM* recommandé pour les applications et les conceptions Intel Edge centrées sur
FPGA Cyclone® V et FPGA SoC
Architecture FPGA SoC Cyclone® V
Les FPGA Cyclone® V perpétuent la tradition de la famille d'appareils Intel® Cyclone® d'une combinaison sans précédent de faible consommation, de fonctionnalités élevées et de faible coût. Utilisez cet appareil pour atteindre la flexibilité, le faible coût et la faible consommation dans diverses applications.
Avantages
Conçu pour les applications à volume élevé et exigeant une bonne rentabilité
Le FPGA Cyclone® V vous permet d'obtenir les niveaux de puissance, de coût et de performance dont vous avez besoin pour les applications à haut volume, notamment le pontage de protocoles, les commandes moteur, les cartes de conversion et de capture vidéo pour la diffusion et les appareils portables. En savoir plus sur les avantages des FPGA Cyclone® V dans un grand choix de segments de marché.
SoC FPGA – Votre SoC personnalisable basé sur le processeur ARM*
Le SoC FPGA vous permet de réduire la puissance et le coût du système ainsi que l'espace de la carte en intégrant un HPS (composé de processeurs, de périphériques et d'un contrôleur de mémoire) à la matrice FPGA à l'aide d'un backbone d'interconnexion à large bande passante. Combiner le HPS avec la structure FPGA basse consommation 28 nm d'Intel permet d'obtenir les performances et l'écosystème d'un processeur ARM* de classe application avec la flexibilité, le faible coût et la faible consommation énergétique du FPGA Cyclone® V.
Réduction du coût total du système grâce à l'intégration
Le FPGA Cyclone® V intègre une multitude de blocs de propriété intellectuelle (IP) durs, si bien que vous pouvez vous différencier et en faire plus en réduisant le coût global du système, la consommation énergétique et le temps de design. Les principaux blocs d'adresses IP matérielles incluent les éléments suivants :
- Contrôleurs de mémoire dure prenant en charge la SDRAM DDR3 400 MHz avec prise en charge optionnelle du code de correction d'erreur (ECC).
- PCI Express* (PCIe*) Gen2 avec prise en charge multifonction.
- Blocs de traitement numérique du signal (DSP) à précision variable.
- Processeur HPS double cœur ARM* Cortex*-A9 MPCore*.
Faible consommation d'énergie et faible coût du système à la pointe de l'industrie
- Jusqu'à 40 % de puissance totale en moins par rapport au FPGA Cyclone® IV GX.
- Émetteurs-récepteurs série à faible puissance avec une consommation électrique maximale de 88 mW par canal à 5 Gbit/s.
- Plus de 4 000 performances de traitement MIPS (référence Dhrystones 2.1) pour moins de 1,8 W (pour SoC FPGA).
- Consommation inférieure grâce à l'utilisation accrue de blocs IP durs.
Permettent également de réduire les coûts - le FPGA requiert uniquement deux tensions de régulateur de puissance et sont équipés de boîtiers de liaison filaire avec des options de petit facteur de forme.
HPS basé sur ARM*
Le SoC Cyclone® V FPGA HPS se compose d’un processeur double cœur ARM* Cortex*-A9 MPCore*, d’un riche ensemble de périphériques et d’un contrôleur de mémoire multiport partagé avec la logique dans le FPGA, vous offrant la flexibilité de la logique programmable et des économies de coûts de propriété intellectuelle matérielle (PI) grâce à :
- Processeur simple ou double cœur avec une fréquence maximale de 925 MHz.
- Grâce aux périphériques intégrés renforcés, il n'est plus nécessaire d'implémenter ces fonctions dans la logique programmable, ce qui laisse davantage de ressources FPGA pour la logique personnalisée spécifique à l'application et réduit la consommation d'énergie.
- Le contrôleur de mémoire multiport renforcé, partagé par le processeur et la logique FPGA, prend en charge les périphériques DDR2, DDR3 et LPDDR2 avec prise en charge intégrée du code de correction d’erreur (ECC) pour les applications haute fiabilité et critiques pour la sécurité.
Interconnexion à haut débit
Les chemins de données à haut débit entre le HPS et la structure FPGA offrent des performances d'interconnexion impossibles dans les solutions à deux puces. Cette intégration étroite offre :
- Plus de 100 Gbit/s de bande passante maximale.
- Cohérence des données intégrées.
- Économies d'énergie importantes du système grâce à l'élimination des chemins d'E/S externes entre le processeur et le FPGA.
Structure FPGA flexible
La structure logique FPGA vous permet de différencier votre système en implémentant une IP personnalisée ou une IP préconfigurée prête à l'emploi d'Intel ou de ses partenaires dans vos conceptions. Cela vous permet de :
- vous adapter rapidement aux normes d'interface et de protocole variables ou changeantes.
- ajouter du matériel personnalisé dans le FPGA pour accélérer les algorithmes critiques et créer un avantage concurrentiel convaincant.
- Déployer rapidement un processeur ARM* personnalisé sans les coûts importants de design, de vérification et d'ingénierie non récurrente (NRE) requis dans les ASIC.
L'architecture compte
Étant donné que Cyclone® FPGA SoC V intègre de nombreux blocs IP durs, vous pouvez réduire le coût global, la consommation et le temps de conception de votre système. FPGA SoC est plus que la somme ou les parties de ses parties. La manière dont le processeur et les systèmes FPGA fonctionnent conjointement est très importante pour les performances, la fiabilité et la flexibilité de votre système. Il est conçu pour :
- Préserver la flexibilité du démarrage du processeur ou de la séquence de configuration FPGA, la réponse du système à la réinitialisation du processeur et les interfaces mémoire indépendantes d'une solution à deux puces.
- maintenir l'intégrité et la fiabilité des données avec l' ECC intégré.
- protéger la mémoire DRAM partagée par le processeur et le FPGA avec une unité de protection de mémoire intégrée.
- Activez le débogage au niveau du système avec le débogage adaptatif pour une visibilité et un contrôle inégalés de l’ensemble de l’appareil.
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