FPGA Intel® Cyclone® 10 LP
La famille de FPGA basse consommation Cyclone® 10 d'Intel élargit la série FPGA Cyclone d'Intel avec des appareils à faible coût et à faible consommation. Idéaux pour les fonctions à volume élevé et sensibles aux coûts, les FPGA basse consommation Intel Cyclone 10 sont conçus pour un large éventail d'applications logiques générales.
Voir aussi : Logiciel de conception FPGA, boutique de conception, téléchargements, communauté et assistance technique
FPGA Intel® Cyclone® 10 LP
Architecture
La structure logique et de routage est entourée de chaque côté par des éléments d'E/S, avec une boucle à verrouillage de phase (PLL) dans chaque coin. Les blocs de mémoire embarqués (M9K) et les blocs multiplicateurs 18 x 18 bits sont disposés en colonnes verticales.
L'architecture comprend également des réseaux d'interconnexion et d'horloge à faible décalage hautement efficaces, assurant la connectivité entre les structures logiques pour l'horloge et le signal de données.
Perturbation d'événement unique (SEU)
Schéma fonctionnel du plan d'étage Cyclone 10 basse consommation La détection d'erreur en mode utilisateur est uniquement prise en charge dans les appareils avec une tension de noyau de 1,2 V. Les circuits dédiés intégrés aux appareils Intel® Cyclone® 10 basse consommation consistent en une fonction de détection d'erreur CRC qui peut éventuellement rechercher une perturbation à événement unique (SEU) en continu et automatiquement.
Dans les applications critiques utilisées dans les domaines de l'avionique, des télécommunications, du contrôle des systèmes, des applications médicales et militaires, il est important de pouvoir :
- Confirmer l'exactitude des données de configuration stockées dans un périphérique FPGA.
- Alerter le système en cas d'erreur de configuration.
Processeur Nios® II
Le processeur Nios® II, le processeur le plus polyvalent au monde, selon Gartner Research, est le processeur logiciel le plus largement utilisé dans le secteur des FPGA. Le processeur Nios® II offre une flexibilité sans précédent pour vos besoins de traitement d'applications sensibles aux coûts, en temps réel, critiques pour la sécurité (DO-254) et optimisées ASIC.
Performances processeur Nios® II (DMIPS à Fmax)
Remarque : banc d'essai Dhrystones 2.1 (estimation Intel)
| Variante | Performances (DMIPS) |
|---|---|
| Nios® II / e Économie | 30 à 175 MHz |
Nios® II / f Rapide |
190 à 165 MHz |
Applications du processeur Nios® II
Application |
Cœurs du processeur Nios® II |
Fabricant |
Descriptif |
|---|---|---|---|
Sensible à la consommation et au coût |
Cœur économique du Nios II |
Tableau de bord |
Avec seulement 600 éléments logiques, le cœur de processeur économique du Nios® II est idéal dans les applications de microcontrôleurs. Le cœur de processeur économique du Nios II, les outils logiciels et les pilotes d'appareils sont offerts gratuitement. |
Temps réel |
Cœur rapide Nios® II |
Tableau de bord |
Performances en temps réel absolument déterministes et sans gigue avec les options de fonctionnalités matérielles en temps réel uniques suivantes :
|
Traitement des applications |
Cœur rapide Nios® II |
Tableau de bord |
Avec une option de configuration simple, le cœur de processeur rapide Nios® II peut utiliser une unité de gestion de la mémoire (MMU) pour exécuter Linux* embarqué. Des versions Open Source et prises en charge dans le commerce de Linux pour processeurs Nios II sont disponibles. |
Critique pour la sécurité |
Cœur Nios® II SC |
HCELL |
Certifiez votre conception pour la conformité DO-254 en utilisant le cœur de processeur Nios® II Safety Critical avec les services de conception de conformité DO-254 offerts par HCELL. |
Lockstep Dual Core |
fRSmartComp IP |
Yogitech |
La solution Lockstep offre une couverture de diagnostic élevée, une auto-vérification et des fonctionnalités de diagnostic avancées en totale conformité avec les normes de sécurité fonctionnelle CEI 61508 et ISO 26262 tout en réduisant le besoin de bibliothèques de tests de logiciels de diagnostic difficiles à développer et qui réduisent les performances. |
Schéma fonctionnel du plan d'étage Cyclone 10 basse consommation La détection d'erreur en mode utilisateur est uniquement prise en charge dans les appareils avec une tension de noyau de 1,2 V. Les circuits dédiés intégrés aux appareils Intel® Cyclone® 10 basse consommation consistent en une fonction de détection d'erreur CRC qui peut éventuellement rechercher une perturbation à événement unique (SEU) en continu et automatiquement.
Dans les applications critiques utilisées dans les domaines de l'avionique, des télécommunications, du contrôle des systèmes, des applications médicales et militaires, il est important de pouvoir :
- Confirmer l'exactitude des données de configuration stockées dans un périphérique FPGA.
- Alerter le système en cas d'erreur de configuration.
Qualification et certification
Les FPGA basse consommation Intel® Cyclone® 10 sont proposés dans des niveaux de température commerciaux, industriels et automobiles (AEC-Q100).
De plus, ils seront pris en charge dans une future version du pack de sécurité fonctionnelle, certifié TUV selon IEC 61508, ce qui réduira le temps de développement et de mise sur le marché.
Autres ressources
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Ressources d'assistance
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Cartes de développement
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Propriété intellectuelle
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Logiciel de conception FPGA
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Contact commercial
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